[白日夢] SystemC與SystemVerilog的未來
SystemC與Verilog目前都有對方不易取代的地方。
例如,SystemC做硬體很難,Verilog寫軟體很難。
SystemC已開始有硬體合成的研究了。
Verilog也不認輸,
SystemVerilog開始有許多programming的元素了,例如OOP。
理論上要把SystemVerilog的OOP compile成software不是什麼問題,
只是目前好像都沒聽說有SystemVerilog的software compiler。
只要這種產品推出,我想SystemC與SystemVerilog又是一場大戰。
說實在SystemVerilog的software compiler真得是可以做做看的研究,
搞不好把GNU CC拿來改一改就可以了。
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信佛的人要知道:佛絕不會說謊。但請把握時光。
法滅盡經:
http://www.cbeta.org/result/normal/T12/0396_001.htm
共勉之。
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※ 發信站: 批踢踢實業坊(ptt.cc)
◆ From: 140.115.221.79
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