[問題] LDO load transient 很冏

看板Electronics作者 (無題)時間16年前 (2009/05/27 23:09), 編輯推噓3(303)
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恕我無法貼圖上來,因為檔案在公司的工作站中,弄不出來啊 \(>口< )/ 所以我就用描述的.. Vout 1.8V, 300mA 的電流輸出 模擬的時候,當負載電流從 100mA 跳至 10uA 時,Vout 端有100mV的 Ripple,像是這樣 1.9v /\ / \ 1.8v --------- ------------- 我希望能壓到 10mV 左右。 請問這跟 LDO 整個的 Open-loop gain 有關嗎? 還是 Feed-back 分壓電阻的關係呢? 請大家指點迷津 拜託咧 \( ̄▽ ̄)/ -- ╭───── ╱╲ ▁▁ ╱╲ ───────────────────╮ |: │ ◢◣ │ __ __ :| | : ╱ ╱ | : _ | |: ◣ ◢◣ ◢ : | : |  ̄ _ : :| ""  ̄ ̄ ╰────── ( ▆▆ ) ────────────────────╯ -- ※ 發信站: 批踢踢實業坊(ptt.cc) ◆ From: 122.116.231.229

05/27 23:59, , 1F
.........LDO 這最基本的電路
05/27 23:59, 1F

05/28 00:00, , 2F
有請一樓指點指點...
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05/28 00:48, , 3F
跟gain沒太大關係 跟頻寬, phase margin有關
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05/28 00:49, , 4F
還有輸出端的穩壓電容也有影響
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05/28 09:38, , 5F
樓上說的是 最簡單調輸出電容 不行就改EA
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06/02 18:15, , 6F
加大EA輸出級的MOS size應該有效 等於輸出寄生容值加大
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