[問題] 關於Layout的問題

看板Electronics作者 (長臂兒)時間19年前 (2007/04/16 01:33), 編輯推噓6(605)
留言11則, 6人參與, 最新討論串1/1
我想問一下版上的各位大大 當我們再畫Layout時 PMOS在設計上 都會比NMOS大 那麼我想問一下 利用寬度(W/L)與利用Multiplier來調整P/N ratio 當兩種的設計方式使P/N ratio相同時 模擬的結果卻不太相同 兩者的差異差在哪裡? 是內部的寄生電容或雜散電容所造成嗎? -- ※ 發信站: 批踢踢實業坊(ptt.cc) ◆ From: 163.25.118.136

04/16 07:54, , 1F
沒記的話應該是寄生電容會有差(請強者糾正..)
04/16 07:54, 1F

04/16 08:47, , 2F
junction電容和gate poly的寄生電阻會有差異
04/16 08:47, 2F

04/16 11:56, , 3F
使用的model不一樣 詳細可以看.l檔 ex: nch.1, nch.2,..
04/16 11:56, 3F

04/16 16:09, , 4F
3樓正解
04/16 16:09, 4F

04/16 16:36, , 5F
3F正解
04/16 16:36, 5F

04/17 01:24, , 6F
感謝樓上各位的回答!!
04/17 01:24, 6F

04/20 13:20, , 7F
模擬結果不一樣是正常.但是若是論準確度的話..用m=x比較好
04/20 13:20, 7F

04/20 13:21, , 8F
作model時會取出幾種size的點來作..這幾個點外的模擬值
04/20 13:21, 8F

04/20 13:22, , 9F
是用公式bimX來推估.所以比較不準.
04/20 13:22, 9F

04/20 13:23, , 10F
用m=x雖然成本(面積)比較高.沒有太大成本壓力時還是優先用
04/20 13:23, 10F

04/20 13:44, , 11F
以上m=x比較準是指作model的那幾個size點而已..其他不算
04/20 13:44, 11F
文章代碼(AID): #168c7d9N (Electronics)